HDL設計入門 : VHDL, Verilog-HDL, 合成を用いた設計 | 金沢大学附属図書館 OPAC plus

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HDL設計入門 : VHDL, Verilog-HDL, 合成を用いた設計. 改訂版

フォーマット:: 図書
責任表示:: 桜井至著
言語:: 日本語
出版情報:: 田無 : テクノプレス, 1997.12
形態:: xii, 252p ; 21cm
著者名:: 桜井, 至 <DA09942113>
書誌ID:: BA34321585
ISBN:: 9784924998247 [4924998249]

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タイトル・著者・出版者が同じ資料

詳細

主題:	集積回路
分類・件名:	BSH : 集積回路
注記:	参考文献一覧: p241-244
タイトルのヨミ、その他のヨミ:	HDL セッケイニュウモン : VHDL Verilog-HDL ゴウセイオモチイタセッケイ
TTLL:	jpn
著者名ヨミ:	サクライ, タカシ

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